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降電壓模塊
降電壓模塊
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電源噪聲是一種常見(jiàn)且不受歡迎的電氣現(xiàn)象。如果不降低噪聲,其會(huì)對(duì)敏感的醫(yī)療、測(cè)試測(cè)量、航空航天和國(guó)防系統(tǒng)的應(yīng)用性能產(chǎn)生不利影響。 當(dāng)今的高精度模擬信號(hào)鏈系統(tǒng)需要直流/直流開(kāi)關(guān)穩(wěn)壓器產(chǎn)生穩(wěn)壓電源軌,為低噪聲應(yīng)用中的模數(shù)轉(zhuǎn)換器(ADC)、數(shù)模轉(zhuǎn)換器(DAC)、現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)及其子系統(tǒng)供電。盡管直流/直流開(kāi)關(guān)穩(wěn)壓器具有高工作效率,它們的開(kāi)關(guān)操作會(huì)導(dǎo)致較大的不連續(xù)電流,從而產(chǎn)生較高的輸入和輸出電壓紋波、頻率尖峰和寬帶噪聲。如果不將這些不連續(xù)電流控制在ADC或DAC的最低有效位毫伏范圍內(nèi),它會(huì)影響系統(tǒng)精度。